PCBSI's Archiver

icedsunx 发表于 2009-8-10 23:45

请问如何给FPGA器件的具体引脚附加模型?

小弟初学Allegro SI。现想仿真XILINX V5的GTP特性。请问如何给器件的某一确定引脚附加 电平模型?
主要是有一点想不明白:器件上的引脚编号为A1,A2,A3……AW1,AW2……AW34;但xilinx提供的IBIS模型中的定义为:
|************************************************************************
|                           Component VIRTEX-5
|************************************************************************
|
[Component]      VIRTEX-5
[Manufacturer]   Xilinx Inc.
[Package]
|FF1136
|variable        typ               min                  max
R_pkg           331.37m             22.22m            1036.83m
L_pkg             3.70nH             0.52nH             10.16nH
C_pkg             2.22pF             0.91pF              5.00pF

[Pin]  signal_name          model_name           R_pin     L_pin     C_pin
PGND   GND                  GND
VCCO   VCCO                 POWER
|  model selector
1       GTL             GTL
2       GTLP            GTLP
3       HSTL_I_12       HSTL_I_12
4       HSTL_I          HSTL_I
5       HSTL_I_18       HSTL_I_18
6       HSTL_II         HSTL_II
7       HSTL_II_18      HSTL_II_18
8       HSTL_III        HSTL_III
9       HSTL_III_18     HSTL_III_18
10      HSTL_IV         HSTL_IV
11      HSTL_IV_18      HSTL_IV_18
12      SSTL18_I        SSTL18_I
13      SSTL2_I         SSTL2_I
14      SSTL18_II       SSTL18_II
15      SSTL2_II        SSTL2_II
|
|  Differential HSTL
|
16P   DIFF_HSTL_I_P           HSTL_I
16N   DIFF_HSTL_I_N           HSTL_I
…………
…………
[Diff Pin]   inv_pin    vdiff   tdelay_typ   tdelay_min   tdelay_max
|
16P           16N         200mV       0            0            0
17P           17N         200mV       0            0            0
18P           18N         200mV       0            0            0
19P           19N         200mV       0            0            0
|
20P           20N         250mV       0            0            0
21P           21N         250mV       0            0            0
22P           22N         310mV       0            0            0
23P           23N         310mV       0            0            0
|
132P          132N        200mV       0            0            0
133P          133N        200mV       0            0            0
134P          134N        200mV       0            0            0
135P          135N        200mV       0            0            0
…………

Triton 发表于 2009-8-11 08:51

你要知道你将仿真的引脚是哪个模型,然后在里面选一个相应的模型就可以,不需要特定哪个pin。

icedsunx 发表于 2009-8-11 22:09

[i=s] 本帖最后由 icedsunx 于 2009-8-11 22:12 编辑 [/i]

谢谢版主。还请指点迷津:
问题是这样的,我用的器件是xilinx的Vertex-5器件,想仿真它的Serdes(GTP)。PCB的electric约束设置中如图:[img][/img]。  在打开IBS model Editor设置差分驱动器时,有报错如下:
ERRORS:
  …………
model VIRTEX_5 defines pin 149P which doesn't exist in component U1
model VIRTEX_5 defines pin 149N which doesn't exist in component U1
model VIRTEX_5 defines pin 148P which doesn't exist in component U1
model VIRTEX_5 defines pin 148N which doesn't exist in component U1
model VIRTEX_5 defines pin 147P which doesn't exist in component U1
model VIRTEX_5 defines pin 147N which doesn't exist in component U1
model VIRTEX_5 defines pin 146P which doesn't exist in component U1
  …………
附IBS Editor中的情况如下:
[img][/img]
不会贴图,图片见附件。

袁荣盛 发表于 2009-8-11 22:18

[quote]谢谢版主。还请指点迷津:
问题是这样的,我用的器件是xilinx的Vertex-5器件,想仿真它的Serdes(GTP)。PCB的electric约束设置中如图:。  在打开IBS model Editor设置差分驱动器时,有报错如下:
ERRORS:
  …… ...
[size=2][color=#999999]icedsunx 发表于 2009-8-11 22:09[/color] [url=http://www.pcbsi.com/redirect.php?goto=findpost&pid=2611&ptid=513][img]http://www.pcbsi.com/images/common/back.gif[/img][/url][/size][/quote]


[b][color=Blue]要修改IBIS的PIN Name和你的封装中的引脚编号一致[/color][/b]
你要是怕麻烦的话可以先不给这个期间赋予model
使用默认model提取拓扑结构
然后再SixP中对Buffer进行修改,调用对应的Model

ripple 发表于 2009-8-11 22:24

还有一个值得注意的问题,对于model selector里面的一大堆buffer,在后仿真阶段提取的拓扑结构时,会默认model selector 名下buffer列表的第一个.需要相SQ正确调你想要的buffer,可能需要修改.

icedsunx 发表于 2009-8-13 23:01

哦,这样子啊,我试试,非常感谢两位版主!!

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