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袁荣盛 发表于 2009-6-24 17:13

DDR2 Design Guideline

很经典的资料
1. Overview
2. General rules
3. Topology and length rules
4. Length matching rules
5. Signal spacing rules

[attach]331[/attach]

Triton 发表于 2009-6-24 17:43

我碰到过一个人，他说他计算出来，DDR2中DQ和DQS可以差几个英寸，我很惊讶

MagyC 发表于 2009-7-9 11:03

这是标准呢，还是哪个厂家的？

ripple 发表于 2009-7-9 11:28

[quote]我碰到过一个人，他说他计算出来，DDR2中DQ和DQS可以差几个英寸，我很惊讶
[size=2][color=#999999]Triton 发表于 2009-6-24 17:43[/color] [url=http://www.pcbsi.com/redirect.php?goto=findpost&pid=1515&ptid=397][img]http://www.pcbsi.com/images/common/back.gif[/img][/url][/size][/quote]

如果按照源同步时序公式+140or180ps/inch那算出来肯定可以差几个inch了！
但是他考虑了多少因素？！串扰、SSN、DDJ、ODT mismatch......

袁荣盛 发表于 2009-7-9 11:36

[quote]这是标准呢，还是哪个厂家的？
[size=2][color=#999999]MagyC 发表于 2009-7-9 11:03[/color] [url=http://www.pcbsi.com/redirect.php?goto=findpost&pid=1759&ptid=397][img]http://www.pcbsi.com/images/common/back.gif[/img][/url][/size][/quote]

DDR2设计JEDEC有一个标准
但明显标准不能满足实际的需求
所以......

Triton 发表于 2009-7-15 17:52

[quote]

如果按照源同步时序公式+140or180ps/inch那算出来肯定可以差几个inch了！
但是他考虑了多少因素？！串扰、SSN、DDJ、ODT mismatch......
[size=2][color=#999999]ripple 发表于 2009-7-9 11:28[/color] [url=http://www.pcbsi.com/redirect.php?goto=findpost&pid=1763&ptid=397][img]http://www.pcbsi.com/images/common/back.gif[/img][/url][/size][/quote]

就是就是，所以我很无语

wanted 发表于 2009-7-23 10:38

这个是厂商的？

changhlg 发表于 2009-8-14 14:40

thanks for your sharing,do you have Allegro SI relation files

2009zenglei 发表于 2009-8-21 00:04

好东西，谢谢

2009zenglei 发表于 2009-8-21 00:05

楼主辛苦了

2009zenglei 发表于 2009-8-21 00:05

必须学习一下

lqb168 发表于 2009-8-22 08:24

学习一下，多谢/

yudyliu 发表于 2009-9-9 12:13

多谢分享!!!

hyacinth 发表于 2009-9-11 15:10

good ,thanks!

iiihome 发表于 2009-11-26 17:39

非常的实用，谢谢！

林东东321 发表于 2010-3-23 02:45

嗯[url=http://www.zmtdg.com/].[/url]..

cht0819 发表于 2010-3-25 16:17

推,很實用的資料

leoliu0804 发表于 2010-4-22 14:41

谢谢.........

zky20048899 发表于 2010-5-27 20:10

Not useful.. waste time

cht0819 发表于 2010-7-5 04:34

很實用,thanks for your sharing

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